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Versorgungsgitter LAE5UM-25F-6BG381E Feldprogrammierbares Tor Array IC
Beschreibung des Produkts
LAE5UM-25F-6BG381E ist so optimiert, dass hohe Leistungsmerkmale wie eine verbesserte DSP-Architektur, hohe SerDes-Geschwindigkeit und hohe Synchronschnittstellen in einem wirtschaftlichen FPGA-Gewebe bereitgestellt werden.
Merkmal
Höhere Logikdichte für eine erhöhte Systemintegration
12K bis 44K LUT
197 bis 203 benutzerprogrammierbare E/A
Eingebettete SerDes
270 Mb/s, bis zu 3,2 Gb/s, SerDes-Schnittstelle (ECP5UM Automotive)
Unterstützt eDP in RDR (1,62 Gb/s) und HDR (2,7 Gb/s)
Bis zu vier Kanäle pro Gerät: PCI Express, Ethernet (1GbE, XAUI und SGMII) und CPRI
Vollständig kaskadierbare Slice-Architektur
12 bis 160 Scheiben für eine hohe Leistungsfähigkeit vermehren und ansammeln
Leistungsstarke 54-Bit-ALU-Betrieb
Zeitteilung Multiplexing MAC-Teilung
Rundung und Verkürzung
Jedes Stück unterstützt
Die Hälfte von 36 x 36, zwei 18 x 18 oder vier 9 x 9 Multiplikatoren
Erweiterte 18 x 36 MAC und 18 x 18 Multiply-Multiply-Accumulate
(MMAC)
Flexible Speicherressourcen
Bis zu 1,944 Mb sysMEMTM Embedded Block RAM (EBR)
194k bis 351k Bits verteilte RAM
sysCLOCK Analog PLLs und DLLs
Vier DLL und vier PLL in LAE5-45; zwei DLL und zwei PLL in LAE5-25 und LAE5-12
Vorentwickelte synchrone Quelle-E/A
DDR-Register in E/A-Zellen
Spezielle Lese-/Schreib-Leveling-Funktion
Spezielle Getriebelogik
Unterstützung synchroner Normen
Die Anzeige ist auf der Website des Herstellers anzugeben.
Hochgeschwindigkeits-ADC/DAC-Geräte